makefile操作方法
一、什么是makefile
makefile是一种文本文件，用于告诉make命令如何编译和链接源代码，是构建和管理软件的重要工具。通过makefile，可以定义源文件、目标文件、编译规则和依赖关系等，使得软件的构建过程自动化。
二、makefile的基本语法
1. 定义变量
在makefile中，可以使用变量来存储常量或文件名。变量的定义使用“=”或“:=”，例如：
```makefile
CC = gcc          # 定义变量CC为gcc编译器
CFLAGS = -Wall    # 定义变量CFLAGS为编译选项-Wall
```
2. 定义规则
makefile中的规则描述了源文件如何编译成目标文件，规则基本格式如下：
```makefile
target: prerequisites
makefile phony    command
```
其中，target是规则的目标文件，prerequisites是目标文件依赖的源文件或其他目标文件，command是编译命令。
3. make命令
make命令用于执行makefile中的规则，自动构建软件。基本用法为：
```shell
make [options] [target]
```
其中，options是make命令的选项，target是要构建的目标文件，默认为第一个规则的目标文件。
三、makefile的常用操作方法
1. 编译单个源文件
要编译单个源文件，可以使用以下规则：
```makefile
target: source.c
    $(CC) $(CFLAGS) -o target source.c
```
其中，target是目标文件，source.c是源文件，$(CC)和$(CFLAGS)是变量，-o表示输出文件名为target。
2. 编译多个源文件
如果要编译多个源文件，可以使用以下规则：
```makefile
target: source1.c source2.c
    $(CC) $(CFLAGS) -o target source1.c source2.c
```
其中，source1.c和source2.c是源文件，$(CC)和$(CFLAGS)是变量，-o表示输出文件名为target。
3. 定义依赖关系
在makefile中，可以定义源文件和目标文件之间的依赖关系，以确保源文件的修改能够自动触发重新编译。例如：
```makefile
target: source1.c source2.c
    $(CC) $(CFLAGS) -o target source1.c source2.c
source1.c: header.h
source2.c: header.h
header.h:
    touch header.h
```
其中，source1.c和source2.c依赖于header.h，如果header.h被修改，会自动触发重新编译。
4. 使用变量
makefile中的变量可以简化编译规则，提高代码的可维护性。例如：
```makefile
CC = gcc
CFLAGS = -Wall
target: source1.c source2.c
    $(CC) $(CFLAGS) -o target source1.c source2.c
```
通过定义变量CC和CFLAGS，可以在编译规则中直接使用，避免重复输入。
5. 清除中间文件
为了清理编译过程中生成的中间文件，可以定义一个清理规则：
```makefile
clean:
    rm -f target *.o
```
执行make命令时，可以通过指定clean作为目标文件来清除中间文件。
四、makefile的高级用法
1. 使用条件判断
makefile支持条件判断，可以根据不同的条件执行不同的规则。例如：
```makefile
ifeq ($(DEBUG), 1)
    CFLAGS += -g
else

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