关于VHDL的IF,CASE语句⽤法
0.0.0最近期末复习，开始学习了⼀遍EDA，感觉好像不是很难的样⼦，但是⽐较繁琐，总有各种各样的⼩细节需要注意。由于下午就要考试了所以我就写⼀点点内容，权当复习了0.0
先讲if语句吧
IF 条件句 THEN
顺序语句;
END IF;
第⼀种if语句⽤于门闩控制，就只有⼀个条件句，是最简单的if语句
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IF 条件句 THEN
顺序语句;
ELSE
顺序语句;
END IF;
第⼆种if语句多⽤于⼆选⼀电路，也很简单啦
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IF 条件句 THEN
顺序语句;
ELSLF 条件句 THEN
顺序语句；
.....（这⾥可以有很多elsif语句）
ELSE(最后⼀句是ELSE，要注意)
顺序语句;
END IF;
第三种多⽤于多选择的控制，这⾥⼀定⼀定要注意是"**ELSIF**"⽽不是ELSEIF
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IF 条件句 THEN
IF 条件句 THEN
顺序语句；
END IF;
END IF;
第四种是if语句嵌套使⽤，多⽤于多个情况组合判断，例如clk电路
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if语句的嵌套例子模板IF 条件句 THEN
顺序语句；
END IF;
IF 条件句 THEN
顺序语句；
END IF;
第五种是if语句并⾏执⾏
case语句也很常⽤
[标号：]CASE 多值表达式 IS
WHEN 选择值=>被赋值变量<=赋值变量；
WHEN 选择值=>被赋值变量<=赋值变量；
WHEN 选择值=>被赋值变量<=赋值变量；
.
..
WHEN OTHERS =>被赋值变量<=赋值变量；
END CASE
还有选择信号赋值语句
WITH 选择表达式 SELECT
被赋值变量<="赋值变量1" WHEN "选择值1",
<="赋值变量2" WHEN "选择值2",
<="赋值变量3" WHEN "选择值3",
...
<="赋值变量n" WHEN OTHERS;
这⾥注意⼀下每句结尾是","⽽最后⼀句结尾是";"
剩下的想到了来补充

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