调制器
小数分频频率合成器中Σ-Δ调制器设计与实现
小数分频频率合成器中Σ-Δ调制器设计与实现晏敏;徐欢;乔树山;杨红官;郑乾;戴荣新;程呈【摘 要】介绍了一种应用于小数分频频率合成器的Σ-Δ调制器的设计,该调制器采用三阶级联的MASH1-1-1结构,并利用流水线技术,提高了调制器的工作频率.电路设计采用Verilog HDL硬件描述语言实现,基于 QuartusⅡ工具进行测试验证,结果表明,调制器最高工作频率为240.56 MHz.最终采用 SM...
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